AD9511BCPZ

AD9511 1.2GHz 时钟分配 IC。它具有多输出时钟分配 IC 功能和片上 PLL 内核。该设计强调低抖动和相位噪声，以最大限度地提高数据转换器的性能。对相位噪声和抖动有严格要求的其他应用也可从该器件中受益。PLL 部分包括一个可编程参考分频器、一个低噪声相位频率检测器、一个精密电荷泵和一个可编程反馈分频器。通过将外部 VCXO 或 VCO 连接到 CLK2/CLK2B 引脚，可将高达 1.6GHz 的频率与输入基准同步。每个输出端都有一个可编程分频器，可以旁路或设置为除以 32 以内的任意整数。应用包括低抖动、低相位噪声时钟分配、高速 ADC、DAC、DDS、DDC、DUC、MxFE、高性能无线收发器、高性能仪器仪表、宽带基础设施的时钟。

• 低相位噪声锁相环内核，可编程双模预分频器
• 可编程电荷泵 (CP) 电流，相位选择用于输出到输出粗延迟调整
• 在 1 个 LVDS/CMOS 输出、串行控制端口上进行微调延迟
• 输入频率范围 0 至 250MHz（VS=3.3V ± 5%，VS ≤ VCPS ≤ 5.5V，TA=25°C，典型值）
• 典型输入灵敏度为 150mV p-p（VS=3.3V ± 5%，VS ≤ VCPS ≤ 5.5V，TA=25°C，典型值）
• 最大 PFD 输入频率为 100MHz（反向间隙脉冲宽度 0Dh<lt/>1:0<gt/>=01b）
• 典型高电平值为 4.8mA（CPRSET=5.1kohm，VS=3.3V ± 5%，VS ≤ VCPS ≤ 5.5V，TA=25°C，典型值）
• 最大输入频率为 1.6GHz（频率 <gt/> 1200MHz 或 800MHz 需要最小除以 2）
• 最大输出频率为 1200MHz（VS=3.3V ± 5%，VS ≤ VCPS ≤ 5.5V，TA=25°C，典型值）
• 48引脚LFCSP封装，温度范围为-40°C至+85°C

注释

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