HSC-ADC-EVALCZ

HSC-ADC-EVALCZ 是基于 FPGA 的数据捕获套件。这是一个高速转换器评估平台 (HSC-ADC-EVALC)，包括最新版本的 VisualAnalog 和基于 FPGA 的缓冲存储器板，用于从 Analog Devices 高速模数转换器 (ADC) 评估板捕获数字数据块。ADC 采集板通过 USB 端口连接到 PC，与 VisualAnalog 一起使用，可快速评估高速 ADC 的性能。用户可以查看特定模拟输入和编码率的 FFT，分析 SNR、SINAD、SFDR 和谐波信息。

• 基于 Xilinx Virtex-4 FPGA 的缓冲存储器板
• 64KB FIFO 深度，与 VisualAnalog® 软件配合使用，可与单通道和多通道 ADC 配合使用
• 支持 1.8V、2.5V 和 3.3V CMOS 和 LVDS 接口以及简单的 USB 端口接口 (2.0)
• 利用 VisualAnalog 测量性能
• 基于 Virtex-4 FPGA
• 可能需要适配器才能与某些 ADC 评估板连接
• 允许对 SPI 控制进行编程，每个通道的编码速率最高可达 644MSPS SDR/800MSPS DDR
• 每个通道的 DDR 编码率
• 可通过 JTAG、板载 EPROM 或 USB 对 FPGA 进行重新配置
• 与 Windows 98（第二版）、Windows 2000、Windows ME 和 Windows XP 兼容

内容

评估板、缓冲存储器板、软件 CD。

注释

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